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    UVM中启动sequence的方法

    第一种(手工启动):在某个component的main_phase中启动sequence,如以my_env和my_sequencer为例:

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    UVM中的PHASE类别及PHASE同步

    UVM中的phase,按照其是否消耗仿真时间($time打印出的时间)的特性,可以分成两大类:一类是function phase,这些phase是通过函数实现;另外一类是task phase,这些phase是通过任务实现的。图1中,灰色背景所示的是task phase,其他白色背景为function phase。

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    SystemVerilog与功能验证

    目录一、功能验证流程二、验证手段、验证技术、验证方法学三、数据类型与编程结构四、并发进程与进程同步五、面向对象编程六、虚接口七、随机测试八、继承与多态九、功能覆盖率十、断言一、功能验证流程功能验证流程主要分为三部分:1、制定验证策略和验证计划;2、创建验证平台,运行和调试;3、回归测试和覆盖率分析。...

  • 发布了文章 ·
    UVM中uvm_component之间的transaction传输

    有5个uvm component class:A, B, C, D, E,需要把一个transaction从A通过B, C, D传到E,怎么传输?

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    UVM如何debug objection

    <sim command> +UVM_OBJECTION_TRACE 当加入了上述的命令行参数后的部分输出如下:

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    UVM中Virtual sequence的作用

    virtual sequence是用来实现sequence之间的同步。从字面上理解,即虚拟的sequence。虚拟的意思就是它根本就不发送transaction,它只是控制其他的sequence,起统一调度的作用。如图1所示,为了使用virtual sequence,一般需要一个virtual sequencer。virtual sequencer里面包含指向其他真实sequencer的指针:

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    ARM各种Memory类型理解

    在看ARM的各个文档时,经常出现很多memory属性相关的词汇,比如Device、Cacheable、Shareable之类,基于这段时间的学习理解和项目实践,把个人的一些理解记录下,仅供参考,有不当之处还望大家指正。我们以CHI issueC P110 表2-12为例,介绍Device、Allocate、Cacheable、EWA(Bufferable)、Order以及SnpAttr如何影响ARM...

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    AMBA CHI知识分享专题

    最近武汉新型冠状病毒肆虐全球,响应国家号召,春节在家足不出户。无聊中,想起可以将去年做的相关ARM CHI协议拿出来梳理下,理清思路,也分享给大家一些个人所得。CHI协议是AMBA的第五代协议,可以说是ACE协议的进化版,将所有的信息传输采用包packet的形式来完成,packet里分各个域段传递不同信息,本质还是用于解决多...

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    CHI的Cache Stashing和DVM操作

    本文介绍CHI协议中的Cache Stashing操作和DVM操作,将分为两章节来描述。作者:谷公子

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    CHI属性、参数和广播信号

    本文描述CHI协议的properties、parameters、broadcast signals,这些指定了一个interface支持的行为。作者:谷公子

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    CHI系统一致性接口

    本节描述系统一致性接口信号,用于控制RN-F是否支持Coherency和DVMdomain,以及RN-D是否支持DVM domain。作者:谷公子

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    CHI保序

    本节介绍了CHI RN的多个transactions保序、RN与其他RN snoop之间的保序、RN与HN之间的保序,并介绍了Streaming Ordered WriteUniques的相关知识点。作者:谷公子

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    CHI Hazard竞争

    本节描述Snoopable transactions之间出现地址hazards and race情况下,RN-F和HN-F如何处理。Non-snoopable transactions之间和Snoopable transactions之间的保序在博客《CHI保序》中讲解。除了多个Requesters可以同时发送多笔transactions,CHI协议允许每个Requester可能发送多笔outstanding requests,也可以接收多笔ou...

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  • 发布了文章 ·
    CHI QOS机制

    本文描述CHI协议支持的Quality of Service(QoS)机制,包含以下内容:OverviewQoS priorityRepeating a transaction with higher QoS value作者:谷公子

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    对「同步电路和异步电路的区别是什么?」的回答

    同步电路:存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源,因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。

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    CHI DFX方法

    本文描述CHI error handling、Data Source和Trace Tag。作者:谷公子

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    CHI Exclusive操作

    本节描述exclusive monitor,Snoopable和Non-snoopable exclusive accesses等作者:谷公子

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    CHI低功耗

    FLit level Clock Gating:该技术用于提供interface的每个channel的周期级活动状态指示。对于每个channel,提供了一个额外的信号用于指示是否一笔传输将在下一个周期发生。该信号允许与interface相关的某些寄存器的本地时钟门控;

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    CHI链路层

    本节描述链路层(Link Layer)用于提供节点之间在Links上的packet传输通讯。Link layer定义了:

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