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用flip-flop和logic-gate设计一个1位加法器，输入carryin和current-stage，输出carryout和next-stage？已解决
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什么是"线与"逻辑,要实现它,在硬件特性上有什么具体要求? 已解决
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什么是竞争与冒险现象?怎样判断?如何消除? 已解决
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你知道那些常用逻辑电平?TTL与COMS电平可以直接互连吗？已解决
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多时域设计中,如何处理信号跨时域？已解决
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给出一个门级的图,又给了各个门的传输延时,问关键路径是什么？已解决
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用一个二选一mux和一个inv实现异或？已解决
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画出CMOS电路的晶体管级电路图,实现Y=A*B+C(D+E)？已解决
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latch与register的区别,为什么现在多用register？已解决
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用D触发器做个二分频的电路，画出逻辑电路？已解决
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2019年08月07日加入

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