baron · 3月21日 · 四川

cache/TLB里分别都有什么?

快速连接

👉👉👉【精选】ARMv8/ARMv9架构入门到精通-目录 👈👈👈


 title=

cache

cache里都有什么? 或者问cache line(即每个entry)里都有什么?
答案是 : TAG + DATA + invalid bit + dirty bit
在这里插入图片描述
那么TAG里又都有什么呢?

L1 data cache tag format with ECC for data register 0 (以为A78为例)
在这里插入图片描述
L1 data cache tag format with ECC for data register 1 (以为A78为例)

L1 data cache tag format with ECC for data register 2 (以为A78为例)
(reserved, 暂不使用)
在这里插入图片描述

所以,这里总结一下:一个cache line有多大? TAG=64bit(8个字节) * 3,data=64bytes,再加上一个invalide bit和一个dirty bit。


TLB

L1 data TLB cache format for data register 0(以为A78为例)
在这里插入图片描述

L1 data TLB cache format for data register 1(以为A78为例)
在这里插入图片描述
所以,这里总结一下:一个TLB entry有多大? 64bit*2 = 16个字节而已。


关注"Arm精选"公众号,备注进ARM交流讨论区。
图片1.png

推荐阅读
关注数
9467
内容数
212
以易懂、渐进、有序的方式,深入探讨ARMv8/ARMv9架构的核心概念。我们将从基础知识开始,逐步深入,覆盖最新的架构,不再纠缠于过时技术。本系列内容包含但不限于ARM基础、SOC芯片基础、Trustzone、gic、异常和中断、AMBA、Cache、MMU等内容,并将持续更新。
目录
极术微信服务号
关注极术微信号
实时接收点赞提醒和评论通知
安谋科技学堂公众号
关注安谋科技学堂
实时获取安谋科技及 Arm 教学资源
安谋科技招聘公众号
关注安谋科技招聘
实时获取安谋科技中国职位信息