棋子 · 2019年10月17日

增加寄存器避免亚稳态，但这能保证输出逻辑是正确的么？

SoC 芯片芯片设计后端

增加寄存器避免亚稳态，但这能保证输出逻辑是正确的么？

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极术小姐姐 · 2019年10月17日

增加寄存器避免亚稳态传播，但是不能纠正逻辑的正确性。如果setup和hold 不能满足，采样结果就不能保证正确性

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