棋子 · 2019年10月17日

Cross-Module reference resolution error

SoC 芯片芯片设计后端

在仿真的时候，发生Cross-Module reference resolution error问题，检查了设计代码，存在该路径，且该信号接地。
请问遇到这个问题 应该考虑哪些语法错误的可能？

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极术小姐姐 · 2019年10月17日

请把你修改过的vcs脚本粘贴到帖子里看一下

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