棋子 · 2019年10月18日

异步时钟之间需要check,通过约束可以彻底消除亚稳态吗？

SoC 芯片芯片设计后端

异步时钟之间需要check,通过约束可以彻底消除亚稳态吗？

1 个回答 得票排序 · 时间排序
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极术小姐姐 · 2019年10月18日

不可以
异步的不能确定实际电路中，数据和时钟的真实check关系。
ASIC中一般都是通过加Synchronizers，来降低亚稳态的概率

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