棋子 · 2019年10月24日

为什么clock gate的latency会比较短？能画图解释下吗

SoC 芯片芯片设计后端

为什么clock gate的latency会比较短？能画图解释下吗

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极术小姐姐 · 2019年10月24日

因为时钟信号从root出来，会先经过clock gate，最终再到clock sink。
相比到sink的latency，到gate的latency当然短啦。

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