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棋子 · 2019年10月16日

二级页表大小设置问题

Arm 芯片设计后端

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棋子 · 2019年10月16日

MMU和MPU的区别是什么?

Arm 芯片设计后端

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棋子 · 2019年10月16日

那thoughput和latency的关系是什么？

Arm 芯片设计后端

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棋子 · 2019年10月16日

可以举例说明什么是out of order的pipeline结构吗

Arm 芯片设计后端

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棋子 · 2019年10月16日

存储器访问顺序的问题1

Arm 芯片设计后端

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棋子 · 2019年10月16日

存储器访问顺序的问题2

Arm 芯片设计后端

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棋子 · 2019年10月16日

cache way 和set的概念不理解

Arm 芯片设计后端

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棋子 · 2019年10月16日

ARM架构下的L1和L2 cache结构有什么联系1

Arm 芯片设计后端

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棋子 · 2019年10月16日

ARM架构下的L1和L2 cache结构有什么联系？

Arm 芯片设计后端

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棋子 · 2019年10月16日

什么时候会触发cache linefill?

Arm 芯片设计后端

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棋子 · 2019年10月16日

cache coherency logic，为什么只把Dcache复制到tag，而不复制Icache？

Arm 芯片设计后端

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棋子 · 2019年10月14日

问device memory bufferable

Arm 芯片设计后端

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棋子 · 2019年10月11日

请教：最近需要使用cortex-a8中PMU进行cycle计数，但是始终不能产生PMCCNTR的溢出中断

Arm 芯片设计后端

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棋子 · 2019年10月11日

如何查找 Cortex M7 的指令执行周期？

Arm 芯片设计后端

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棋子 · 2019年08月13日

在有rtl之前，只知道芯片估计的规模，如何估算功耗?

SoC 芯片芯片设计后端

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