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SoC 芯片
系统芯片（英语：System on a Chip，缩写：SoC）是一个将计算机或其他电子系统集成到单一芯片的集成电路。
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棋子
· 2019年10月17日
编译阶段，VCS不需要给相应stdcell、mem的库吗
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
ICL 的 定义 ， 只 定义 instrumnet 不定义 SIB， tap 等 是否可以 ？
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
对于 stuck_at 和 transition pattern ,
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
lab9 run 完 并没有 C1 violation ， 好像 lab 和 说明里的 不相符合啊
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
netlist验证和后仿验证有什么区别？和前仿真区别呢？
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
模块、子系统、和系统三者验证区别是什么？是否都可以跑c来验证？
SoC 芯片
芯片设计后端
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棋子
· 2019年10月17日
为什么fpga开发板可以跑c代码？fpga原型验证综合arm处理器吗？
SoC 芯片
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棋子
· 2019年10月17日
svt是表示什么意思
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棋子
· 2019年10月17日
子系统级验证环境-ahb vip example运行 没有添加DUT，怎么直接仿真？仿真的结果代表了什么？
SoC 芯片
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棋子
· 2019年10月17日
uvm基类的内容在哪查看？
SoC 芯片
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棋子
· 2019年10月17日
请问一下，如何才能提高模块的覆盖率，具体思路和方法是什么?_?
SoC 芯片
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棋子
· 2019年10月17日
to type 型Iso与用在input的Iso关系
SoC 芯片
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棋子
· 2019年10月17日
在实际的流程中 什么情况下使用top upf什么情况使用chip upf？
SoC 芯片
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棋子
· 2019年10月17日
UART的最高频率是3MHz么，最低频率是48Hz么？同时进行读写，一个buffer会不会冲突。
SoC 芯片
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棋子
· 2019年10月17日
UART 的设计规格-UART 设计SPEC 功能 不支持校验位 1bit校验位 两个功能冲突 ，那个为准
SoC 芯片
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棋子
· 2019年10月17日
Clock_info03a问题blackbox
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棋子
· 2019年10月17日
Ac_glitch03问题
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棋子
· 2019年10月17日
Clock_info03a问题comblogic
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棋子
· 2019年10月17日
Clock_info05问题
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棋子
· 2019年10月17日
Lab2 D1采样信号不稳定，这个结论不理解。
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