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异步时钟之间需要check,通过约束可以彻底消除亚稳态吗?
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跨时钟域scan chain 在 occ 滤出的两个function clock pulse下会不会有亚稳态问题?
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hierarchical atpg scan
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DFT: OCC 插入
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哪些寄存器是不需要上chain呢?为什么不需要上chain?
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同一时钟域的上升沿和下降沿触发器可以串在同一条链上:下降沿寄存器在前,上升沿在后
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DFT : 后端做完 scan reorder 后, 是不是一定要重新产生pattern 才能仿真pass ?
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block wrapper 起什么作用?
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capture-DR这个状态,capture什么数据
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DFT 产生的RTL test logic 的综合问题
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对于inout类型的io,bsd cell应该是什么样的?
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可选指令集的功能是否可以由必选指令集实现?
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boundary scan用到和没用到的PAD在处理pull up/down时有区别吗?分别应该如何处理?
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scan 时 memory 或者 macro 的output 怎么处理?
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请问PR后的网表做stuckat仿真时出现mismatch该如何debug
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Cross-Module reference resolution error
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编译阶段,VCS不需要给相应stdcell、mem的库吗
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ICL 的 定义 , 只 定义 instrumnet 不定义 SIB, tap 等 是否可以 ?
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对于 stuck_at 和 transition pattern ,
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lab9 run 完 并没有 C1 violation , 好像 lab 和 说明里的 不相符合啊
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2019年08月07日 加入
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