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棋子 · 2019年10月16日

在axi协议里面提到的写通道信息可以被认为是buffered如何理解？

Arm 芯片设计后端

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棋子 · 2019年10月16日

计算外设APB的时钟频率?

Arm 芯片设计后端 APB

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棋子 · 2019年10月16日

pready的这句描述怎么理解？

Arm 芯片设计后端

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棋子 · 2019年10月16日

如何将APB3的slave改为APB4的slave？

Arm 芯片设计后端 APB

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棋子 · 2019年10月16日

为什么做dft的时候，要把 clock gate bypass掉？

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棋子 · 2019年10月16日

为什么clock gate在综合的时候要调用库单元？

Arm 芯片设计后端

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棋子 · 2019年10月16日

APB4 中peripherals的security属性是怎么产生的？

Arm 芯片设计后端

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棋子 · 2019年10月16日

make sim_vcs出现问题

Arm 芯片设计后端

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棋子 · 2019年10月16日

VCS编译问题不通过如何解决

Arm 芯片设计后端

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棋子 · 2019年10月16日

AHB BUS matrix的应用和讲解无法结合在一起

Arm 芯片设计后端

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棋子 · 2019年10月16日

为什么精简指令集功耗比复杂指令集低？

Arm 芯片设计后端

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棋子 · 2019年10月16日

请问M7内核55nm工艺最高可以跑多高频率？

Arm 芯片设计后端

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棋子 · 2019年10月16日

请问老师什么叫babo啊？

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棋子 · 2019年10月16日

flush掉5条指令的话，会对CPI产生什么样的影响？不是应该是1.25么

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棋子 · 2019年10月16日

return address 被哪些指令使用呢？

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棋子 · 2019年10月16日

RAS是不是和调用子程序时的压栈重复了

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棋子 · 2019年10月16日

PC的低10bit能索引1024个entry的BTB吗？

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棋子 · 2019年10月16日

什么是 Speculation access？CPU又是在什么情况下会发起Speculation access？

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棋子 · 2019年10月16日

关于如何对TLB进行索引

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棋子 · 2019年10月16日

为什么page要越小越好

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棋子 · 2019年10月16日

多级页表的意义理解较模糊

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棋子 · 2019年10月16日

多级page table是否可以用一级page table代替

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棋子 · 2019年10月16日

为什么物理地址和虚拟地址不能一一对应？

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棋子 · 2019年10月16日

不同架构处理器page size或是page table的级数不同，如何最优的page size与page table组合？

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棋子 · 2019年10月16日

为什么物理地址编译后不能动态的修改物理地址空间

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棋子 · 2019年10月16日

二级页表大小设置问题

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棋子 · 2019年10月16日

MMU和MPU的区别是什么?

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棋子 · 2019年10月16日

那thoughput和latency的关系是什么？

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棋子 · 2019年10月16日

可以举例说明什么是out of order的pipeline结构吗

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棋子 · 2019年10月16日

存储器访问顺序的问题1

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