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· 2023年05月22日
细聊时钟树综合CTS阶段如何去降低Latency和Skew
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棋子
· 2023年05月18日
Constrained random value generation的记录
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下冰雹
· 2023年05月18日
正确认识原型验证多片FPGA自动分割工具
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下冰雹
· 2023年05月17日
处理FPGA原型设计需要多长时间?
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下冰雹
· 2023年05月16日
FPGA原型验证系统的时钟资源
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下冰雹
· 2023年05月15日
基于移位寄存器的TDM的实现方式
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下冰雹
· 2023年05月15日
低功耗设计详解(UPF编码篇)
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下冰雹
· 2023年05月12日
浅谈System Verilog的DPI机制
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棋子
· 2023年05月12日
在芯片研发工作中,你犯过哪些“愚蠢”的错误?
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棋子
· 2023年05月11日
UVM response_handler和get_response机制
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下冰雹
· 2023年05月11日
【芯知识】SoC设计的IO PAD怎么移植到FPGA原型验证
2
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棋子
· 2023年05月10日
【芯知识】多片FPGA原型验证系统互连拓扑分析
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下冰雹
· 2023年05月10日
ICer必备技能,一文带你了解Python的使用!
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下冰雹
· 2023年05月08日
一份MCU的验证计划,大家看看全不全?
3
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下冰雹
· 2023年05月06日
浅谈验证平台的通讯机制
4
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下冰雹
· 2023年05月05日
UVM中add_typewide_sequence和add_sequence的区别
4
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棋子
· 2023年05月04日
Systemverilog里class类型的记录
3
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棋子
· 2023年04月28日
浅谈做芯片和建高楼的相似性和相通性
3
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下冰雹
· 2023年04月28日
Systemverilog中array的记录
2
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棋子
· 2023年04月27日
对SoC进行手动FPGA分区
3
阅读 1.5k
下冰雹
· 2023年04月27日
Systemverilog里data type的记录
1
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棋子
· 2023年04月26日
多片FPGA原型系统:多路复用(TDM)科普
4
阅读 1.7k
下冰雹
· 2023年04月26日
Systemverilog里class类型的记录
3
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棋子
· 2023年04月25日
【芯知识】SoC的RTL移植到FPGA的RTL修改啥?
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下冰雹
· 2023年04月25日
IR Drop与封装
3
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下冰雹
· 2023年04月25日
Systemverilog中operators和expression的记录
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棋子
· 2023年04月24日
多片FPGA原型两种分割方式:RTL级别分割和网表级别分割
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Dskpimc?
· 2023年04月23日
UVM中使用put_response的一个注意点
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下冰雹
· 2023年04月23日
IC各细分领域公司简介以及薪资调研(FPGA篇)
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Dskpimc?
· 2023年04月21日
Systemverilog中Clocking blocks的记录
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