在前面的练习中，我们使用简单的逻辑门和多个逻辑门的组合。这些电路是组合电路的例子。组合意味着电路的输出只是其输入的函数（在数...
转载自：知乎首先附上传送门：[链接]Problem 45 NOR实现如下电路：解析： 一个或非门 {代码...} Problem 46 Another gate实现如下电路：...
设计电路来计算输入矢量中 ’1‘ 的个数，题目要求建立一个255bit输入的矢量来判断输入中 ’1‘ 的个数。
1、连续赋值和过程赋值之间有什么区别？2、initial和always中的赋值有什么区别？initial和always中的赋值都是过程赋值。3、阻塞和非阻塞...
转载自：知乎本系列文章将和读者一起巡礼数字逻辑在线学习网站 HDLBits 的教程与习题，并附上解答和一些作者个人的理解，相信无论是想 7...
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转载自：知乎本系列文章将向大家推荐一个学习 Verilog 的好去处：HDLBits. HDLBits 在提供 Verilog 基础语法教程的同时，还能够在线仿真...
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1、generate用法定义genvar，作为generate中的循环变量；generate语句中定义的for语句，必须要有begin，为后续增加标签做准备；begin必...
下面是门控时钟（clock gating）的最简单实现方法（使用与门）：从理论上讲，这是可行的：当使能信号Enable为高电平时，时钟将被传递到...
写此文时，时间临近国庆。中午的阳光还似盛夏，不过气温低了许多。路边插了很多红色的旗帜，超市的折扣让这几天更加喜庆。
所复用的两个时钟频率可以完全无关，也可以是彼此的倍数。在任何一种情况下，都有可能在时钟切换时产生毛刺。时钟上的毛刺会造成整个系...
要获得一个高质量的Topographical synthesis结果，需要一个良好的physical start point。
门级仿真(Gate level simulation)是对综合后,已经完成映射(mapping )到工艺库的数字设计进行验证的方法。
Verilog设计和测试平台的编码风格可能会影响仿真过程的正确（Correctness）和性能（performance），其中涉及仿真正确性的一个方面就是不...
